一种移位寄存电路及显示装置的制作方法

本发明实施例涉及显示技术，尤其涉及一种移位寄存电路及显示装置。

背景技术：

随着显示技术的不断发展，显示面板的应用也越来越广泛，例如，显示面板应用于手机、电脑、平板电脑、电子书和信息查询机等产品，此外还可以应用于仪表类显示器(例如车载显示器)和智能家居的控制面板等。

现有的显示面板通过移位寄存电路逐行扫描各行像素，从而显示画面。移位寄存电路包括多个级联的移位寄存器，移位寄存器通过多个晶体管以及电容的电路结构实现逐行扫描的功能。移位寄存电路通常设置于显示面板的左右边框，除上述电路元件外，还需要设置信号线，为各级移位寄存器传输电压信号和时钟信号等信号。

若移位寄存器中晶体管的数量较多，信号线的数量也可能会增多，不利于窄边框的实施。

技术实现要素：

本发明实施例提供一种移位寄存电路及显示装置，通过简化移位寄存器的结构，实现窄边框。

第一方面，本发明实施例提供了一种移位寄存电路，包括：多级移位寄存器；移位寄存器包括输入模块、分压模块、下拉模块和输出模块；

输入模块连接于第一电压信号端和第一节点之间，用于在输入阶段开启，以将第一电压信号端提供的第一电压信号输出至第一节点；

分压模块内部具有第二节点，分压模块连接于第一电压信号端和第二电压信号端之间，分压模块的第一控制端连接于第一移位寄存信号端、第二控制端连接于第二移位寄存信号端且第三控制端连接于第一节点，分压模块用于调节第二节点的电位；

下拉模块的控制端连接于第二节点，下拉模块的第一端连接于第一节点、第二端连接于移位寄存器的输出端且第三端连接于第二电压信号端，用于在开启时，下拉第一节点的电位和移位寄存器的输出端的电位；

输出模块连接于第一时钟信号端和移位寄存器的输出端之间，移位寄存器的输出端和第一节点之间耦接一耦合电容，输出模块用于在输出阶段开启，以将第一时钟信号端提供的第一时钟信号输出至移位寄存器的输出端。

第二方面，本发明实施例还提供了一种显示装置，包括：上一方面提供的移位寄存器电路。

本发明实施例提供的移位寄存电路中，移位寄存器包括输入模块、分压模块、下拉模块和输出模块；输入模块用于在输入阶段开启，将第一电压信号端提供的第一电压信号输出至第一节点；分压模块内部具有第二节点，分压模块用于调节第二节点的电位；下拉模块的控制端连接于第二节点，用于在开启时，下拉第一节点的电位和移位寄存器的输出端的电位；输出模块用于在输出阶段开启，将第一时钟信号端提供的第一时钟信号输出至移位寄存器的输出端，该移位寄存器的结构简单，相比于现有技术而言，可省去关断模块及其相应的信号线，从而占用空间更小，有利于实现窄边框。

附图说明

图1是现有技术中的一种移位寄存器的电路示意图；

图2是本发明实施例提供的一种移位寄存器的结构示意图；

图3是本发明实施例提供的一种移位寄存器的电路示意图；

图4是本发明实施例提供的一种移位寄存器的驱动时序示意图；

图5是本发明实施例提供的移位寄存器在第一下拉阶段的示意图；

图6是本发明实施例提供的移位寄存器在输入阶段的示意图；

图7是本发明实施例提供的移位寄存器在输出阶段的示意图；

图8是本发明实施例提供的移位寄存器在第二下拉阶段的示意图；

图9是本发明实施例提供的另一种移位寄存器的电路示意图；

图10是本发明实施例提供的一种移位寄存器的局部结构示意图；

图11是本发明实施例提供的另一种移位寄存器的局部结构示意图；

图12是本发明实施例提供的另一种移位寄存器的局部结构示意图；

图13是本发明实施例提供的一种移位寄存电路的结构示意图；

图14是本发明实施例提供的一种移位寄存电路的驱动时序示意图；

图15是本发明实施例提供的一种显示装置的结构示意图。

具体实施方式

下面结合附图和实施例对本发明作进一步的详细说明。可以理解的是，此处所描述的具体实施例仅仅用于解释本发明，而非对本发明的限定。另外还需要说明的是，为了便于描述，附图中仅示出了与本发明相关的部分而非全部结构。

示例性的，图1是现有技术中的一种移位寄存器的电路示意图，如图1所示，现有的移位寄存电器中设置有关断模块01，关断模块01还单独设置有信号线bw，导致移位寄存电路占用面积较大，不利于实现窄边框。

为解决上述问题，本申请实施例提供了一种移位寄存电路，包括多级移位寄存器；移位寄存器包括输入模块、分压模块、下拉模块和输出模块；输入模块连接于第一电压信号端和第一节点之间，用于在输入阶段开启，以将第一电压信号端提供的第一电压信号输出至第一节点；分压模块内部具有第二节点，分压模块连接于第一电压信号端和第二电压信号端之间，分压模块的第一控制端连接于第一移位寄存信号端、第二控制端连接于第二移位寄存信号端且第三控制端连接于第一节点，分压模块用于调节第二节点的电位；下拉模块的控制端连接于第二节点，下拉模块的第一端连接于第一节点、第二端连接于移位寄存器的输出端且第三端连接于第二电压信号端，用于在开启时，下拉第一节点的电位和移位寄存器的输出端的电位；输出模块连接于第一时钟信号端和移位寄存器的输出端之间，移位寄存器的输出端和第一节点之间耦接一耦合电容，输出模块用于在输出阶段开启，以将第一时钟信号端提供的第一时钟信号输出至移位寄存器的输出端。

采用以上技术方案，可以实现移位寄存电路对像素阵列的逐行扫描功能，而且相比现有技术而言，无需设置关断模块，还可以省去与关断模块连接的信号线，从而占用空间更小，有利于实现窄边框。

以上是本申请的核心思想，基于本申请中的实施例，本领域普通技术人员在没有做出创造性劳动前提下，所获得的所有其他实施例，都属于本申请保护的范围。以下将结合本申请实施例中的附图，对本申请实施例中的技术方案进行清楚、完整地描述。

本实施例提供一种移位寄存电路，该移位寄存电路包括多级移位寄存器。图2是本发明实施例提供的一种移位寄存器的结构示意图，如图2所示，移位寄存器100包括输入模块10、分压模块20、下拉模块30和输出模块40。输入模块10连接于第一电压信号端vgh和第一节点p之间，用于在输入阶段开启，以将第一电压信号端vgh提供的第一电压信号输出至第一节点p。分压模块20内部具有第二节点q，分压模块20连接于第一电压信号端vgh和第二电压信号端vgl之间，分压模块20的第一控制端连接于第一移位寄存信号端gn 1、第二控制端连接于第二移位寄存信号端gn-1且第三控制端连接于第一节点p，分压模块20用于调节第二节点q的电位。下拉模块30的控制端连接于第二节点q，下拉模块30的第一端连接于第一节点p、第二端连接于移位寄存器的输出端out且第三端连接于第二电压信号端vgl，用于在开启时，下拉第一节点p的电位和移位寄存器的输出端out的电位。输出模块40连接于第一时钟信号端clk和移位寄存器的输出端out之间，移位寄存器的输出端out和第一节点p之间耦接一耦合电容c，输出模块40用于在输出阶段开启，以将第一时钟信号端clk提供的第一时钟信号输出至移位寄存器的输出端out。

移位寄存电路包括多级移位寄存器，各级移位寄存器可依次向对应的栅极线提供扫描信号。

本实施例中，移位寄存器包括分压模块20，分压模块20内部具有第二节点q，且连接于第一电压信号端vgh和第二电压信号端vgl之间，分压模块20的第一控制端连接于第一移位寄存信号端gn 1、第二控制端连接于第二移位寄存信号端gn-1且第三控制端连接于第一节点p，用于调节第二节点q的电位。具体的，分压模块20可以包括若干晶体管，通过第一移位寄存信号端gn 1、第二移位寄存信号端gn-1以及第一节点p的电位，可以控制第一电压信号端vgh与第二节点q之间以及第二节点q与第二电压信号端vgl之间晶体管的通断状态，进而可以将第一电压信号端vgh的第一电压信号输出至第二节点q，或者将第二电压信号端vgl的第二电压信号输出至第二节点q，实现调节第二节点q的电位。示例性的，当第一电压信号端vgh与第二节点q之间为开启状态，第二节点q与第二电压信号端vgl之间为关断状态时，分压模块20将第一电压信号端vgh的第一电压信号输出至第二节点q；当第一电压信号端vgh与第二节点q之间为开启状态，第二节点q与第二电压信号端vgl之间为开启状态时，分压模块20将第二电压信号端vgl的第一电压信号输出至第二节点q。

进一步的，本实施例中，下拉模块30的控制端连接于第二节点q，因此，第二节点q处于不同电位时，下拉模块30的通断状态不同。具体的，当第二节点q的电位处于使能电平的状态时，下拉模块30开启，使得第二电压信号端vgl的第二电压信号传输至第一节点p以及移位寄存器的输出端out，下拉第一节点p的电位和移位寄存器的输出端out的电位；第二节点q的电位处于非使能电平的状态时，下拉模块30关断，第二电压信号端vgl的第二电压信号不会传输至第一节点p以及移位寄存器的输出端out，不会对第一节点p的电位和移位寄存器的输出端out的电位造成影响。

可选的，移位寄存器的工作阶段可以包括第一下拉阶段和第二下拉阶段；第一下拉阶段在输入阶段之前执行，下拉模块30执行第一次下拉操作，下拉第一节点p的电位和移位寄存器的输出端out的电位；第二下拉阶段在输出阶段之后执行，下拉模块30执行第二次下拉操作，下拉第一节点p的电位和移位寄存器的输出端out的电位。

具体的，在第一下拉阶段，在第二节点q的使能电平的控制下，下拉模块30开启，将第二电压信号端vgl的第二电压信号传输至第一节点p以及移位寄存器的输出端out，下拉第一节点p的电位和移位寄存器的输出端out的电位。

在输入阶段，在第二移位寄存信号端gn-1的使能电平的控制下，输入模块10开启，将第一电压信号端vgh的第一电压信号传输至第一节点p，对第一节点p进行充电。此时，可通过分压模块20调节第二节点q的电位为非使能电平的状态，将下拉模块30关断，以使第二电压信号端vgl的第二电压信号不会传输至第一节点p和移位寄存器的输出端out。

在输出阶段，由于耦合电容c对第一节点p的电位进行存储，因此，第一节点p的电位保持使能电平的状态，输出模块40在第一节点p的电位控制下开启，将第一时钟信号端clk提供的第一时钟信号输出至移位寄存器的输出端out，向对应的栅极线提供扫描信号。此时，可通过分压模块20调节第二节点q的电位为非使能电平的状态，将下拉模块30关断，以使第二电压信号端vgl的第二电压信号不会传输至第一节点p和移位寄存器的输出端out。

在第二下拉阶段，在第二节点q的使能电平的控制下，下拉模块30开启，将第二电压信号端vgl的第二电压信号传输至第一节点p以及移位寄存器的输出端out，下拉第一节点p的电位和移位寄存器的输出端out的电位。

至此，移位寄存器的一个周期的工作过程结束，直至下一次第二移位寄存信号端gn-1的电位处于使能电平的状态，开启下一周期的工作过程。

本发明实施例提供的移位寄存电路中，移位寄存器包括输入模块、分压模块、下拉模块和输出模块；输入模块用于在输入阶段开启，将第一电压信号端提供的第一电压信号输出至第一节点；分压模块内部具有第二节点，分压模块用于调节第二节点的电位；下拉模块的控制端连接于第二节点，用于在开启时，下拉第一节点的电位和移位寄存器的输出端的电位；输出模块用于在输出阶段开启，将第一时钟信号端提供的第一时钟信号输出至移位寄存器的输出端，该移位寄存器的结构简单，相比于现有技术而言，可省去关断模块及其相应的信号线，从而占用空间更小，有利于实现窄边框。

图3是本发明实施例提供的一种移位寄存器的电路示意图，参见图3，可选的，输入模块10包括第一晶体管t1；第一晶体管t1连接于第一电压信号端vgh和第一节点p之间，第一晶体管t1的控制端连接于第二移位寄存信号端gn-1。在输入阶段，第二移位寄存信号端gn-1的电位处于使能电平的状态，第一晶体管t1开启，第一电压信号端vgh的第一电压信号传输至第一节点p，对第一节点p进行充电。

继续参见图3，可选的，输出模块40包括第二晶体管t2；第二晶体管t2连接于第一时钟信号端clk和移位寄存器的输出端out之间，第二晶体管t2的控制端连接于第一节点p。在输出阶段，第一节点p的电位处于使能电平的状态，第二晶体管t2开启，第一时钟信号端clk提供的第一时钟信号传输至移位寄存器的输出端out，向对应的栅极线提供扫描信号。

参见图2，可选的，分压模块20包括第一分压单元21和第二分压单元22；第一分压单元21连接于第一电压信号端vgh和第二节点q之间，且第一分压单元21的第一控制端连接于第一移位寄存信号端gn 1；第二分压单元22连接于第二电压信号端vgl和第二节点q之间，且第二分压单元22的第一控制端连接于第二移位寄存信号端gn-1，第二分压单元22的第二控制端连接于第一节点p；第一分压单元21用于在开启时，将第一电压信号输出至第二节点q；第二分压单元22用于在开启时，将第二电压信号端vgl提供的第二电压信号输出至第二节点q。

其中，第一分压单元21的第一控制端为分压模块20的第一控制端，第一分压单元21的第一控制端连接于第一移位寄存信号端gn 1；第二分压单元22的第一控制端为分压模块20的第二控制端，第二分压单元22的第一控制端连接于第二移位寄存信号端gn-1；第二分压单元22的第二控制端为分压模块20的第三控制端，第二分压单元22的第二控制端连接于第一节点p，分别用于控制第一分压单元21和第二分压单元22的通断状态。

其中，第一分压单元21用于在开启时，将第一电压信号输出至第二节点q；第二分压单元22用于在开启时，将第二电压信号端vgl提供的第二电压信号输出至第二节点q。具体的，当第一分压单元21开启，第二分压单元22关断时，第一电压信号端vgh的第一电压信号输出至第二节点q，拉高第二节点q的电位；当第二分压单元22开启时，第二电压信号端vgl的第二电压信号输出至第二节点q，下拉第二节点q的电位。

参见图3，可选的，第一分压单元21包括第三晶体管t3和第四晶体管t4，第三晶体管t3和第四晶体管t4均连接于第一电压信号端vgh和第二节点q之间，第三晶体管t3的控制端连接于第一移位寄存信号端gn 1，第四晶体管t4的控制端连接于第一电压信号端vgh；第二分压单元22包括第五晶体管t5和第六晶体管t6，第五晶体管t5和第六晶体管t6均连接于第二电压信号端vgl和第二节点q之间，第五晶体管t5的控制端连接于第二移位寄存信号端gn-1，第六晶体管t6的控制端连接于第一节点p。具体的，当第三晶体管t3和/或第四晶体管t4开启时，第一分压单元21开启，当第五晶体管t5和/或第六晶体管t6开启时，第二分压单元22开启。

参见图2，可选的，下拉模块30包括第一下拉单元31和第二下拉单元32；第一下拉单元31连接于第一节点p和第二电压信号端vgl之间，且第一下拉单元31的控制端连接于第二节点q；第二下拉单元32连接于移位寄存器的输出端out和第二电压信号端vgl之间，且第二下拉单元32的控制端连接于第二节点q；第一下拉单元31和第二下拉单元32同时开启或同时关断，开启时，将第一节点p的电位和移位寄存器的输出端out的电位下拉至第二电压信号端vgl提供的第二电压信号。

第一下拉单元31的控制端和第二下拉单元32的控制端均连接于第二节点q，因此，当第二节点q的电位处于使能电平的状态时，第一下拉单元31和第二下拉单元32同时开启，将第一节点p的电位和移位寄存器的输出端out的电位下拉至第二电压信号端vgl提供的第二电压信号；当第二节点q的电位处于非使能状态时，第一下拉单元31和第二下拉单元32同时关断，第二电压信号端vgl的第二电压信号不会传输至第一节点p和移位寄存器的输出端out。

参见图3，可选的，第一下拉单元31包括第七晶体管t7，第二下拉单元32包括第八晶体管t8。第七晶体管t7的控制端和第八晶体管t8的控制端均与第二节点q电连接，第七晶体管t7连接于第一节点p和第二电压信号端vgl之间，第八晶体管t8连接于移位寄存器的输出端out和第二电压信号端vgl之间。

可选的，第七晶体管t7的宽长比大于现有技术(图1)中晶体管m2的宽长比。

对比图1和图3，现有技术中(图1)，第一节点p通过晶体管m1与信号端bw连接，并通过晶体管m2与信号端vgl连接，正向扫描时，信号端bw为低电平，因此，基于晶体管的特性，第一节点p会通过晶体管m1和m2向低电平端漏电。而本实施例中(图3)，第一节点p通过第七晶体管t7与第二电压信号端vgl连接，因此，第一节点p会通过第七晶体管t7向第二电压信号端vgl漏电。为了保证本实施例中第一节点p的漏电量和漏电流与现有技术一致，以保证移位寄存器的性能稳定性，需要使第七晶体管t7的漏电流与晶体管m1和m2的漏电流之和相当，因此，需要降低第七晶体管t7的电阻。本实施例通过设置第七晶体管t7的宽长比大于现有技术(图1)中晶体管m2的宽长比，以增大第七晶体管t7的宽长比的方式，降低第七晶体管t7的电阻，进而保证本实施例中第一节点p的漏电量和漏电流与现有技术一致，保证移位寄存器的性能稳定性。

示例性的，移位寄存器中的晶体管例如可以为nmos晶体管，此时，可选各信号端输出信号的使能电平为高电平，非使能电平为低电平，第一电压信号端vgh提供的第一电压信号为大于0v的高电平信号，第二电压信号端vgl提供的第二电压信号为小于或等于0v的低电平信号。相应的，图4是本发明实施例提供的一种移位寄存器的驱动时序示意图，参见图4，移位寄存器的工作过程包括第一下拉阶段s1、输入阶段s2、输出阶段s3和第二下拉阶段s4。

图5是本发明实施例提供的移位寄存器在第一下拉阶段的示意图，结合图4和图5所示，在第一下拉阶段s1，第一电压信号端vgh的第一电压信号为高电平，第四晶体管t4开启；第一节点p的初始电位为较低，因此，第六晶体管t6关断，同时，由于第一移位寄存信号端gn 1的第一移位寄存信号为低电平，第二移位寄存信号端gn-1的第二移位寄存信号为低电平，因此，第三晶体管t3和第五晶体管t5均关断，第一电压信号端vgh的第一电压信号通过第四晶体管t4传输至第二节点q，拉高第二节点q的电位。进一步的，由于第二节点q的电位升高，使得第七晶体管t7和第八晶体管t8开启，第一节点p的电位和移位寄存器的输出端out的电位下拉至第二电压信号端vgl提供的第二电压信号。

图6是本发明实施例提供的移位寄存器在输入阶段的示意图，结合图4和图6所示，在输入阶段s2，输入模块10(t1)、第二分压单元22(t5和t6)和第四晶体管t4均开启，第一电压信号(vgh)写入第一节点p，且第二电压信号(vgl)写入第二节点q。具体的，在输入阶段s2，第二移位寄存信号端gn-1的第二移位寄存信号为高电平，因此，第一晶体管t1和第五晶体管t5开启，第一电压信号端vgh提供的第一电压信号通过第一晶体管t1传输至第一节点p，对第一节点p进行充电，拉高第一节点p的电位。同时，由于第一节点p电位升高，使得第六晶体管t6开启，第二电压信号端vgl的第二电压信号通过第五晶体管t5和第六晶体管t6传输至第二节点q，从而可以迅速拉低第二节点q的电位，进而使第七晶体管t7和第八晶体管t8关断，避免第七晶体管t7和第八晶体管t8在输入阶段s2异常开启而拉低第一节点p的电位。

图7是本发明实施例提供的移位寄存器在输出阶段的示意图，结合图4和图7，在输出阶段s3，输出模块40(t2)、第四晶体管t4和第六晶体管t6均开启，第一时钟信号端clk提供的第一时钟信号输出至移位寄存器的输出端out。具体的，在输出阶段s3，第一节点p的电位由于耦合电容c的作用保持高电位，因此，第二晶体管t2开启，第一时钟信号端clk的第一时钟信号通过第二晶体管t2传输至移位寄存器的输出端out。同时，由于第一节点p为高电平，使得第六晶体管t6开启，第二电压信号端vgl的第二电压信号通过第六晶体管t6传输至第二节点q，拉低第二节点q的电位，使第七晶体管t7和第八晶体管t8关断，第二电压信号端vgl的第二电压信号不会传输至第一节点p和移位寄存器的输出端out。

图8是本发明实施例提供的移位寄存器在第二下拉阶段的示意图，结合图4和图8，在第二下拉阶段s4，第一移位寄存信号端gn 1的第一移位寄存信号为高电平，因此，第三晶体管t3开启，同时，第四晶体管t4开启，此外，由于输出阶段s3耦合电容c放电，使得第一节点p的电位下降，因此，第六晶体管t6关断，同时，由于第二移位寄存信号端gn-1的第二移位寄存信号为低电平，因此，第五晶体管t5关断，使得第一电压信号端vgh的第一电压信号可以通过第三晶体管t3和第四晶体管t4传输至第二节点q，迅速拉高第二节点q的电位，进而使第七晶体管t7和第八晶体管t8开启，将第二电压信号端vgl的第二电压信号传输至第一节点p和移位寄存器的输出端out，拉低第一节点p的电位和移位寄存器的输出端out的电位，避免移位寄存器的输出信号异常，影响正常显示。

图9是本发明实施例提供的另一种移位寄存器的电路示意图，参见图9，可选的，移位寄存器100还包括：复位模块50，复位模块50连接于第一节点p和第二电压信号端vgl之间，用于在复位阶段开启，以使第一节点p复位至第二电压信号端vgl提供的第二电压信号。

第一节点p上可能会积累静电，在输入阶段s2之前，需要将静电释放掉，以避免第一节点p上的残留静电对移位寄存器的输出信号产生影响，影响显示效果。由于第一下拉阶段s1的持续时间通常较短，在输入阶段s2开始时，第一节点p的电位可能未下降至第二电压信号端vgl提供的第二电压信号，本实施例通过设置复位模块50，使复位模块50在复位阶段开启，可以辅助下拉模块30中的第七晶体管t7，将第一节点p的电位迅速复位至第二电压信号端vgl提供的第二电压信号，从而可以消除第一节点p上的静电，保证移位寄存器的输出信号正常，进而保证显示效果。

可选的，复位阶段可以位于第一下拉阶段s1之后，输入阶段s2之前；或者，复位阶段可以与第一下拉阶段s1重叠；或者，复位阶段可以与第一下拉阶段s1部分交叠，且第一下拉阶段s1的起始时刻位于复位阶段之前。

示例性的，参见图9，复位模块50可以包括第九晶体管t9，第九晶体管t9连接于第一节点p和第二电压信号端vgl之间，第九晶体管t9的栅极与复位信号端reset连接，当复位信号端reset的电位为使能电平的状态时，第九晶体管t9开启，第一节点p的电位复位至第二电压信号端vgl提供的第二电压信号。

同理，参见图9，可选的，移位寄存器100还包括：初始化模块60，初始化模块60连接于移位寄存器的输出端out和第二电压信号端vgl之间，用于在初始化阶段开启，以使移位寄存器的输出端out初始化至第二电压信号(vgl)。

本实施例通过设置初始化模块60，使其在初始化阶段开启，可以辅助下拉模块30中的第八晶体管t8，在输入阶段s2之前，将移位寄存器的输出端out迅速初始化至第二电压信号(vgl)，避免因移位寄存器的输出端out残留静电而对输出信号产生影响，保证显示效果正常。

可选的，初始化阶段可以位于第一下拉阶段s1之后，输入阶段s2之前；或者，初始化阶段可以与第一下拉阶段s1重叠；或者，初始化阶段可以与第一下拉阶段s1部分交叠，且第一下拉阶段s1的起始时刻位于初始化阶段之前。

示例性的，参见图9，初始化模块60可以包括第十晶体管t10，第十晶体管t10连接于移位寄存器的输出端out和第二电压信号端vgl之间，第十晶体管t10的栅极与初始化信号端goff连接，当初始化信号端goff的电位为使能电平的状态时，第十晶体管t10开启，移位寄存器的输出端out的电位初始化至第二电压信号端vgl提供的第二电压信号。

除此之外，参照图9，本实施例通过设置复位模块50和初始化模块60，还可以在第二节点q失效(例如电位较低)，无法正常开启第七晶体管t7和第八晶体管t8的情况下，利用复位模块50将第一节点p的电位下拉至第二电压信号端vgl提供的第二电压信号，利用初始化模块60将移位寄存器的输出端out的电位下拉至第二电压信号端vgl提供的第二电压信号，代替下拉模块30实现其在第一下拉阶段s1和第二下拉阶段s4的功能，保证移位寄存器可以正常工作。

可选的，复位阶段和初始化阶段的时间段至少部分重叠。如此设置，可以减小移位寄存器的栅极扫描时间，提高显示装置的扫描频率，实现高分辨率。

综上，上述实施例对移位寄存器的电路结构做了详细说明，下面对移位寄存器的膜层结构做如下说明。

图10是本发明实施例提供的一种移位寄存器的局部结构示意图，参见图10，可选的，移位寄存电路还包括：栅极金属层、源漏极金属层和第一金属层，栅极金属层、源漏极金属层和第一金属层不同层设置，第一金属层包括第一跨桥结构101；第二晶体管t2的栅极和第一节点p采用第一桥接换线孔连接于同一第一跨桥结构101，栅极金属层和第一节点p所在金属层不同层设置。

参照图10，第二晶体管t2的栅极201所在膜层为栅极金属层，第二晶体管t2的源极202和漏极203所在膜层为源漏极金属层，第一跨桥结构101所在膜层为第一金属层。

如图9所示，第一节点p同时与第二晶体管t2的栅极、第六晶体管t6的栅极、第七晶体管t7的漏极以及第九晶体管t9的漏极连接，而晶体管的栅极和源漏极位于不同的金属层，因此，需要采用跨桥结构将位于不同层的金属结构连接，即将第二晶体管t2和第六晶体管t6的栅极与第七晶体管t7和第九晶体管t9的漏极连接在第一节点p。

如图10所示，可选的，第一节点p与源漏极金属层同层。如此，第一节点p所在金属层与第七晶体管t7和第九晶体管t9的源漏极同层，与第二晶体管t2和第六晶体管t6的栅极不同层，可以通过第一跨桥结构101将第二晶体管t2的栅极与第一节点p连接。至于同层的金属结构，则可以在其所在膜层连接。

上述结构仅为示例，并非限定，在其他实施例中，可选第一节点p所在金属层与栅极金属层同层，第一节点p和第九晶体管t9的漏极通过跨桥结构连接，本领域技术人员可根据实际情况设置。

同理，图11是本发明实施例提供的另一种移位寄存器的局部结构示意图，参照图9和图11，可选的，第一金属层包括第二跨桥结构102；第四晶体管t4的栅极401和第四晶体管t4的源极402采用第二桥接换线孔连接于同一第二跨桥结构102。

图12是本发明实施例提供的另一种移位寄存器的局部结构示意图，参照图9和图12，可选的，第一金属层包括第三跨桥结构103；第七晶体管t7的栅极701和第二节点q采用第三桥接换线孔连接于同一第三跨桥结构103，栅极金属层和第二节点q所在金属层不同层设置。可选的，第二节点q与源漏极金属层同层。如图12所示，第二节点q与第七晶体管t7的源极702和漏极703同层设置。

上述结构仅为示例，并非限定，在其他实施例中，可选第二节点q所在金属层与栅极金属层同层，第三晶体管t3的源极与第二节点q通过跨桥结构连接，本领域技术人员可根据实际情况设置。

图11和图12所示结构的具体设计原理请参照图10相关内容的描述，在此不再赘述。示例性的，上述跨桥结构的材料可以为氧化铟锡(ito)。

由于跨桥结构所在的金属层更加靠近显示面板的上表面，因此，在高温高湿环境下，若环境中的水分进入显示面板内部，容易引起跨桥结构腐蚀断路，导致屏幕显示异常。图1和图9中，两个圆形虚线框及其之间的虚线表示一个跨桥结构，对比图1和图9可以看出，本实施例通过去除现有技术中的关断模块01，还可以减少跨桥结构的数量，降低发生线路腐蚀的概率。

综上，上述实施例对移位寄存器的膜层结构做了简要说明，下面对移位寄存电路中各级移位寄存器的连接关系做如下说明。

图13是本发明实施例提供的一种移位寄存电路的结构示意图，参见图13，移位寄存电路200中，第一移位寄存信号端gn 1连接于下一级移位寄存器的输出端out，第二移位寄存信号端gn-1连接于上一级移位寄存器的输出端out，以实现多级移位寄存器100的级联。

图14是本发明实施例提供的一种移位寄存电路的驱动时序示意图，参照图13和图14，输入信号端stv与第一级移位寄存电路asg1的第二移位寄存信号端gn-1连接，用于触发第一级移位寄存器asg1进入输入阶段s2，移位寄存器的工作过程在此不再赘述。当第一级移位寄存器asg1的输出端out1向对应的栅极线输出扫描信号时，该输出信号传输至第二级移位寄存器asg2的第二移位寄存信号端gn-1，从而使第二级移位寄存器asg2进入输入阶段s2，接着，当第二级移位寄存器asg2的输出端out2向对应的栅极线输出扫描信号时，其输出信号可同时传输至第一级移位寄存器asg1的第一移位寄存信号端gn 1和第三级移位寄存器asg3的第二移位寄存信号端gn-1，使第一移位寄存器asg1进入第二下拉阶段s4，而第三级移位寄存器asg3则进入输入阶段s2……。依次类推，移位寄存电路200中的多级移位寄存器100可依次向对应的栅极线输出扫描信号，实现像素阵列的逐行扫描。

基于同样的发明构思，本发明实施例还提供了一种显示装置，图15是本发明实施例提供的一种显示装置的结构示意图，该显示装置300包括上述任一实施例提供的移位寄存电路，移位寄存电路可以位于显示区aa左右两侧的非显示区。该显示装置具备与上述移位寄存电路相同的有益效果，相同之处可参照上述移位寄存电路实施例的描述，在此不再赘述。本发明实施例提供的显示装置300可以为图15所示的手机，也可以为任何具有显示功能的电子产品，包括但不限于以下类别：电视机、笔记本电脑、桌上型显示器、平板电脑、数码相机、智能手环、智能眼镜、车载显示器、医疗设备、工控设备、触摸交互终端等，本发明实施例对此不作特殊限定。

注意，上述仅为本发明的较佳实施例及所运用技术原理。本领域技术人员会理解，本发明不限于这里所述的特定实施例，对本领域技术人员来说能够进行各种明显的变化、重新调整和替代而不会脱离本发明的保护范围。因此，虽然通过以上实施例对本发明进行了较为详细的说明，但是本发明不仅仅限于以上实施例，在不脱离本发明构思的情况下，还可以包括更多其他等效实施例，而本发明的范围由所附的权利要求范围决定。