模拟数字转换器及其操作方法与流程

1.本发明关于电子电路，特别是一种模拟数字转换器及其操作方法。


背景技术：

2.模拟数字转换器(analog-to-digital converter,adc)是用于将模拟形式的连续信号转换为数字形式的离散信号的装置，在音频系统、视频系统、通讯系统、以及各种数字信号处理系统中得到广泛运用。逐次逼近寄存器(successive approximation register,sar)模拟数字转换器是一种模拟数字转换器，使用电容阵列进行模拟至数字转换，具有低功耗的特性，适用于移动装置或便携装置。然而，由于sar adc采用的电容阵列中电容的不匹配，会造成sar adc的非线性误差，降低sar adc的精确度。


技术实现要素：

3.本发明的实施例提供一种模拟数字转换器的操作方法。模拟数字转换器包含第一电容阵列、第一选择电路、第二电容阵列、第二选择电路、比较器及控制逻辑电路。第一电容阵列中的每组电容包含第一电容及第二电容，具有实质上相等的电容值。第一电容阵列的一组较大电容的第一电容的第一电容部分的电容值实质上等于第一电容阵列的一组较小电容的第一电容的电容值。第一电容阵列的该组较大电容的第二电容的第一电容部分的电容值实质上等于第一电容阵列的该组较小电容的第一电容的电容值。第二电容阵列中的每组电容包含第一电容及第二电容，具有实质上相等的电容值。第二电容阵列的一组较大电容的第一电容的第一电容部分的电容值实质上等于第二电容阵列的一组较小电容的第一电容的电容值。第二电容阵列的该组较大电容的第二电容的第一电容部分的电容值实质上等于第二电容阵列的该组较小电容的第一电容的电容值。第一选择电路耦接于第一电容阵列，第二选择电路耦接于第二电容阵列，比较器包含第一输入端，耦接于第一电容阵列，及第二输入端，耦接于第二电容阵列，控制逻辑电路耦接于第一选择电路、第二选择电路及比较器。操作方法包含在第一取样期间，第一选择电路将第一参考电压输出至第一电容阵列中的每组电容的第一电容以及将第二参考电压输出至第一电容阵列中的每组电容的第二电容，第二选择电路将第一参考电压输出至第二电容阵列中的每组电容的第一电容以及将第二参考电压输出至第二电容阵列中的每组电容的第二电容；在第一转换期间，比较器比较第一输入端的电压及第二输入端的电压以产生第一比较结果，第一选择电路将第二参考电压输出至第一电容阵列的该组较大电容的第一电容，第二选择电路将第一参考电压输出至第二电容阵列的该组较大电容的第二电容；以及在第一转换期间后的第二转换期间，比较器比较第一输入端的电压及第二输入端的电压以产生第二比较结果，第一选择电路将第一参考电压输出至第一电容阵列的该组较大电容的第一电容的第一电容部分或第一电容阵列的该组较大电容的第二电容的第一电容部分，第二选择电路将第二参考电压输出至第二电容阵列的该组较大电容的第一电容的第一电容部分或第二电容阵列的该组较大电容的第二电容的第一电容部分。第一比较结果及第二比较结果相异。
附图说明
4.图1是本发明实施例中一种模拟数字转换器的电路示意图。
5.图2是图1中的模拟数字转换器的一种操作方法的流程图。
具体实施方式
6.图1是本发明实施例中一种模拟数字转换器1的电路示意图。模拟数字转换器1是3位分裂电容(split capacitor)逐次逼近寄存器(successive approximation register,sar)模拟数字转换器，可依据逐次逼近方法(如二元搜寻法)将差动输入电压vip,vin转换为数字输出数据dout。差动输入电压vip,vin可分别由第一信号源及第二信号源提供。数字输出数据dout可包含3位。模拟数字转换器1可在每个操作周期内产生一组数字输出数据dout。每个操作周期可包含取样阶段(或称为采集阶段)及量化阶段(或称为转换阶段)，模拟数字转换器1可在取样阶段对差动输入电压vip,vin进行取样以产生一对取样信号，以及在量化阶段将该对取样信号进行量化以产生数字输出数据dout。量化阶段可包含多(3)次转换，用以依次产生数字输出数据dout的多个(3)位。在多个取样阶段中，模拟数字转换器1可依据2种电压设置而被重置，由此降低由于电容性元件失配产生的电压误差，降低其积分非线性(integral nonlinearity，inl)误差及微分非线性(differential nonlinearity，dnl)误差，同时提供高速模拟至数字转换。
7.模拟数字转换器1可包含开关sw1及开关sw2、第一电容阵列141、第一选择电路121、第二电容阵列142、第二选择电路122、比较器16及控制逻辑电路18。第一选择电路121及开关sw1耦接于第一电容阵列141，第二选择电路122及开关sw2耦接于第二电容阵列142。比较器16可包含第一接收端，耦接于第一电容阵列141，第二接收端，耦接于第二电容阵列142，及输出端，耦接于控制逻辑电路18。控制逻辑电路18耦接于第一选择电路121及第二选择电路122。
8.第一电容阵列141可包含3组电容，3组电容的电容值可全部相同、部分相同或各不相同，且可依设计需求而改变。在一些实施例中，3组电容的电容值各不相同，每组电容包含第一电容及第二电容，第一电容及第二电容具有实质上相等的电容值。第一电容阵列141的第一组电容可包含第一电容c1pa及第二电容c1pb，第二组电容可包含第一电容c2pa及第二电容c2pb，第三组电容可包含第一电容c3pa及第二电容c3pb。第一电容阵列141的第一组电容、第二组电容及第三组电容可分别对应数字输出数据dout的最高有效位(most significant bit,msb)至最低有效位(least significant bit,lsb)。第一电容c1pa及第二电容c1pb可分别具有实质上相等的电容值3c，且第一电容阵列141的第一组电容可具有电容值6c；第一电容c2pa及第二电容c2pb可分别具有实质上相等的电容值2c，且第一电容阵列141的第二组电容可具有电容值4c；第一电容c3pa及第二电容c3pb可分别具有实质上相等的电容值1c，且第一电容阵列141的第三组电容可具有电容值2c。第一电容阵列141的第一组电容的第一电容c1pa还分为第一电容部分c1pa1及第二电容部分c1pa2，第一电容阵列141的第一组电容的第二电容c1pb还分为第一电容部分c1pb1及第二电容部分c1pb2。电容c1pa1,c1pa2,c1pb1,c1pb2,c2pa,c2pb,c3pa,c3pb,可各自包含上板及下板。电容c1pa1,c1pa2,c1pb1,c1pb2,c2pa,c2pb,c3pa,c3pb的上板可耦接至开关sw1以及比较器16的第一输入端。
9.相似地，第二电容阵列142也包含3组电容，3组电容的电容值各不相同，每组电容包含第一电容及第二电容，第一电容及第二电容具有实质上相等的电容值。第二电容阵列142的第一组电容可包含第一电容c1na及第二电容c1nb，第二组电容可包含第一电容c2na及第二电容c2nb，第三组电容可包含第一电容c3na及第二电容c3nb。第二电容阵列142的第一组电容、第二组电容及第三组电容可分别对应数字输出数据dout的最高有效位至最低有效位。第一电容c1na及第二电容c1nb可分别具有实质上相等的电容值3c，且第二电容阵列142的第一组电容可具有电容值6c；第一电容c2na及第二电容c2nb可分别具有实质上相等的电容值2c，且第二电容阵列142的第二组电容可具有电容值4c；第一电容c3na及第二电容c3nb可分别具有实质上相等的电容值1c，且第二电容阵列142的第三组电容可具有电容值2c。第二电容阵列142的第一组电容的第一电容c1na还分为第一电容部分c1na1及第二电容部分c1na2，第二电容阵列142的第一组电容的第二电容c1nb还分为第一电容部分c1nb1及第二电容部分c1nb2。电容c1na1,c1na2,c1nb1,c1nb2,c2na,c2nb,c3na,c3nb可各自包含上板及下板。电容c1na1,c1na2,c1nb1,c1nb2,c2na,c2nb,c3na,c3nb的上板可耦接至开关sw2，以及比较器16的第二输入端。
10.第一选择电路121可接收第一参考电压v1及第二参考电压v2以设置第一电容阵列141的3组电容，第二选择电路122可接收第一参考电压v1及第二参考电压v2以设置第二电容阵列142的3组电容。在一些实施例中，第一参考电压v1可以是供电电压，例如1.8v，第二参考电压v2可以是接地电压，例如0v。在另一些实施例中，第一参考电压v1可以是接地电压，第二参考电压v2可以是供电电压。第一选择电路121可耦接于电容c1pa1,c1pa2,c1pb1,c1pb2,c2pa,c2pb,c3pa,c3pb的下板。第二选择电路122可耦接于电容c1na1,c1na2,c1nb1,c1nb2,c2na,c2nb,c3na,c3nb的下板。
11.第一选择电路121及第二选择电路122可由一个或多个多路复用器和/或开关实现，但不限于此。第一选择电路121的一个或多个多路复用器和/或开关可从控制逻辑电路18接收选择信号以分别从第一参考电压v1及第二参考电压v2中选择一个以输出至电容c1pa1,c1pa2,c1pb1,c1pb2,c2pa,c2pb,c3pa,c3pb。第二选择电路122的一个或多个多路复用器和/或开关可从控制逻辑电路18接收选择信号以分别从第一参考电压v1及第二参考电压v2中选择一个以输出至电容c1na1,c1na2,c1nb1,c1nb2,c2na,c2nb,c3na,c3nb的下板。为了简洁，以下段落所述的第一选择电路121将选定电压输出至第一电容阵列141中的电容表示输出至第一电容阵列141中的电容的下板，且第二选择电路122将选定电压输出至第二电容阵列142中的电容表示输出至第二电容阵列142中的电容的下板。
12.在取样阶段时，开关sw1及开关sw2可被导通，且第一电容阵列141及第二电容阵列142可分别取样差动输入电压vip,vin。在取样期间，第一选择电路121及第二选择电路122可将第一种电压设置或第二种电压设置中的电压输出至电容c1pa1,c1pa2,c1pb1,c1pb2,c2pa,c2pb,c3pa,c3pb及电容c1na1,c1na2,c1nb1,c1nb2,c2na,c2nb,c3na,c3nb。表格1及表格2分别显示第一种电压设置及第二种电压设置:
13.表格1
14.电容c1pa1c1pa2c1pb1c1pb2c2pac2pbc3pac3pb下板电压v1v1v2v2v1v2v1v2电容c1na1c1na2c1nb1c1nb2c2nac2nbc3nac3nb
下板电压v1v1v2v2v1v2v1v2
15.表格2
16.电容c1pa1c1pa2c1pb1c1pb2c2pac2pbc3pac3pb下板电压v2v2v1v1v2v1v2v1电容c1na1c1na2c1nb1c1nb2c2nac2nbc3nac3nb下板电压v2v2v1v1v2v1v2v1
17.在一些实施例中，第一选择电路121可在取样期间将第一种电压设置中的对应电压输出至电容c1pa1,c1pa2,c1pb1,c1pb2,c2pa,c2pb,c3pa,c3pb的下板，开关sw1可被导通以将差动输入电压vip传送至电容c1pa1,c1pa2,c1pb1,c1pb2,c2pa,c2pb,c3pa,c3pb的上板，由此在比较器16的第一接收端建立电压vp；第二选择电路122可在取样期间将第一种电压设置中的对应电压输出至电容c1na1,c1na2,c1nb1,c1nb2,c2na,c2nb,c3na,c3nb的下板，开关sw2可被导通以将差动输入电压vin传送至电容c1na1,c1na2,c1nb1,c1nb2,c2na,c2nb,c3na,c3nb的上板，由此在比较器16的第二接收端建立电压vn。在另一些实施例中，第一选择电路121可在取样期间将第二种电压设置中的对应电压输出至电容c1pa1,c1pa2,c1pb1,c1pb2,c2pa,c2pb,c3pa,c3pb的下板，开关sw1可被导通以将差动输入电压vip传送至电容c1pa1,c1pa2,c1pb1,c1pb2,c2pa,c2pb,c3pa,c3pb的上板，由此建立电压vp；第二选择电路122可将第二种电压设置中的对应电压输出至电容c1na1,c1na2,c1nb1,c1nb2,c2na,c2nb,c3na,c3nb的下板，开关sw2可被导通以将差动输入电压vin传送至电容c1na1,c1na2,c1nb1,c1nb2,c2na,c2nb,c3na,c3nb的上板，由此建立电压vn。
18.在量化阶段，模拟数字转换器1可针对数字输出数据dout的3位进行3次转换，比较器16可比较电压vp及vn以产生3个比较结果，控制逻辑电路18可将每个比较结果储存作为数字输出数据dout的1位的位值，以及依据每个比较结果设定第一选择电路121及第二选择电路122以更新电压vp及vn。比较结果可以是二进位”0”或二进位”1”。举例而言，当进行最高有效位的转换时，若电压vp大于电压vn，则比较器16可产生二进位”1”做为比较结果，控制逻辑电路18可将二进位”1”储存作为最高有效位，设定第一选择电路121以输出接地电压至电容c1pa1,c1pa2,c1pb1,c1pb2的下板以下拉电压vp，以及设定第二选择电路122以输出供电电压至电容c1na1,c1na2,c1nb1,c1nb2的下板以提升电压vn。更新后的电压vp会较先前的电压vp低，更新后的电压vn会较先前的电压vn高。若电压vp小于电压vn，则比较器16可产生二进位”0”做为比较结果，控制逻辑电路18可将二进位”0”储存作为最高有效位，设定第一选择电路121以输出供电电压至电容c1pa1,c1pa2,c1pb1,c1pb2的下板以提升电压vp，以及设定第二选择电路122以输出接地电压至电容c1na1,c1na2,c1nb1,c1nb2的下板以下拉电压vn。更新后的电压vp会较先前的电压vp高，更新后的电压vn会较先前的电压vn低。模拟数字转换器1可依序比较及更新电压vp及vn以产生数字输出数据dout的3位的3位值，以及输出数字输出数据dout以供后续使用。
19.图2是模拟数字转换器1的操作方法200的流程图。方法200包含步骤s202至s206。步骤s202用以在取样期间重置第一电容阵列141及第二电容阵列142。步骤s204及s206用以在转换期间切换第一电容阵列141及第二电容阵列142以产生数字输出数据dout。任何合理的技术变更或是步骤调整都属于本发明所公开的范围。步骤s202至s206如下:
20.步骤s202:在第一取样期间，第一选择电路121将第一参考电压v1输出至第一电容
阵列141中的每组电容的第一电容以及将第二参考电压v2输出至第一电容阵列141中的每组电容的第二电容，第二选择电路122将第一参考电压v1输出至第二电容阵列142中的每组电容的第一电容以及将第二参考电压v2输出至第二电容阵列142中的每组电容的第二电容；
21.步骤s204:在第一转换期间，比较器16比较电压vp及电压vn以产生第一比较结果，第一选择电路121将第二参考电压v2输出至第一电容阵列141的一组较大电容的第一电容，第二选择电路122将第一参考电压v1输出至第二电容阵列142的一组较大电容的第二电容；
22.步骤s206:在第二转换期间，比较器16比较电压vp及电压vn以产生第二比较结果，第一选择电路121将第一参考电压v1输出至第一电容阵列141的该组较大电容的第一电容的第一电容部分或第一电容阵列141的该组较大电容的第二电容的第一电容部分，第二选择电路122将第二参考电压v2输出至第二电容阵列142的该组较大电容的第一电容的第一电容部分或第二电容阵列142的该组较大电容的第二电容的第一电容部分。
23.在步骤s206中，第一比较结果及第二比较结果相异。在一些实施例中，第一比较结果可显示电压vp大于电压vn且第二比较结果可显示电压vp小于电压vn，且第一参考电压v1可大于第二参考电压v2。在另一些实施例中，第一比较结果可显示电压vp小于电压vn且第二比较结果可显示电压vp大于电压vn，且第一参考电压v1可小于第二参考电压v2。以下结合模拟数字转换器1来说明操作方法200的步骤。
24.在第一取样期间，第一选择电路121及第二选择电路122分别使用表格1显示的第一种电压设置重置第一电容阵列141及第二电容阵列142(步骤s202)。若第一参考电压v1为供电电压且第二参考电压v2为接地电压，在第一转换期间，若第一比较结果显示电压vp大于电压vn，则第一选择电路121将第二参考电压v2输出至第一电容阵列141的第一组电容的第一电容c1pa的第一电容部分c1pa1及第二电容部分c1pa2，第二选择电路122将第一参考电压v1输出至第二电容阵列142的第一组电容的第二电容c1nb的第一电容部分c1nb1及第二电容部分c1nb2，如表格3所示(步骤s204):
25.表格3
26.电容c1pa1c1pa2c1pb1c1pb2c2pac2pbc3pac3pb下板电压“v2”“v2”v2v2v1v2v1v2电容c1na1c1na2c1nb1c1nb2c2nac2nbc3nac3nb下板电压v1v1“v1”“v1”v1v2v1v2
27.在第二转换期间，若第二比较结果显示电压vp小于电压vn，则第一选择电路121将第一参考电压v1输出至第一电容阵列141的第一组电容的第一电容c1pa的第一电容部分c1pa1以将第一电容部分c1pa1回切至其重置值(v1)，第二选择电路122将第二参考电压v2输出至第二电容阵列142的第一组电容的第二电容c1nb的第一电容部分c1nb1以将第一电容部分c1nb1回切至其重置值(v2)，如表格4所示(步骤s206):
28.表格4
29.电容c1pa1c1pa2c1pb1c1pb2c2pac2pbc3pac3pb下板电压“v1”v2v2v2v1v2v1v2电容c1na1c1na2c1nb1c1nb2c2nac2nbc3nac3nb下板电压v1v1“v2”v1v1v2v1v2
30.在另一些实施例中，在第二转换期间，若第二比较结果显示电压vp小于电压vn，则第一选择电路121将第一参考电压v1输出至第一电容阵列141的第一组电容的第二电容c1pb的第一电容部分c1pb1，第二选择电路122将第二参考电压v2输出至第二电容阵列142的第一组电容的第一电容c1na的第一电容部分c1na1，如表格5所示(步骤s206):
31.表格5
32.电容c1pa1c1pa2c1pb1c1pb2c2pac2pbc3pac3pb下板电压v2v2“v1”v2v1v2v1v2电容c1na1c1na2c1nb1c1nb2c2nac2nbc3nac3nb下板电压“v2”v1v1v1v1v2v1v2
33.若第一参考电压v1为接地电压且第二参考电压v2为供电电压，在第一转换期间，若第一比较结果显示电压vp小于电压vn，则第一选择电路121将第二参考电压v2输出至第一电容阵列141的第一组电容的第一电容c1pa的第一电容部分c1pa1及第二电容部分c1pa2，第二选择电路122将第一参考电压v1输出至第二电容阵列142的第一组电容的第二电容c1nb的第一电容部分c1nb1及第二电容部分c1nb2，如表格3所示(步骤s204)。在第二转换期间，若第二比较结果显示电压vp大于电压vn，则第一选择电路121将第一参考电压v1输出至第一电容阵列141的第一组电容的第一电容c1pa的第一电容部分c1pa1，第二选择电路122将第二参考电压v2输出至第二电容阵列142的第一组电容的第二电容c1nb的第一电容部分c1nb1，如表格4所示(步骤s206)。在另一些实施例中，在第二转换期间，若第二比较结果显示电压vp大于电压vn，则第一选择电路121将第一参考电压v1输出至第一电容阵列141的第一组电容的第二电容c1pb的第一电容部分c1pb1，第二选择电路122将第二参考电压v2输出至第二电容阵列142的第一组电容的第一电容c1na的第一电容部分c1na1，如表格5所示(步骤s206)。
34.在另一些实施例中，在第一取样期间，第一选择电路121及第二选择电路122分别使用表格2显示的第二种电压设置重置第一电容阵列141及第二电容阵列142(步骤s202)。若第一参考电压v1为供电电压且第二参考电压v2为接地电压，在第一转换期间，若第一比较结果显示电压vp大于电压vn，则第一选择电路121将第二参考电压v2输出至第一电容阵列141的第一组电容的第二电容c1pb的第一电容部分c1pb1及第二电容部分c1pb2，第二选择电路122将第一参考电压v1输出至第二电容阵列142的第一组电容的第一电容c1na的第一电容部分c1na1及第二电容部分c1na2，如表格6所示(步骤s204):
35.表格6
36.电容c1pa1c1pa2c1pb1c1pb2c2pac2pbc3pac3pb下板电压v2v2“v2”“v2”v2v1v2v1电容c1na1c1na2c1nb1c1nb2c2nac2nbc3nac3nb下板电压“v1”“v1”v1v1v2v1v2v1
37.在第二转换期间，若第二比较结果显示电压vp小于电压vn，则第一选择电路121将第一参考电压v1输出至第一电容阵列141的第一组电容的第二电容c1pb的第一电容部分c1pb1以将第一电容部分c1pb1回切至其重置值(v1)，第二选择电路122将第二参考电压v2输出至第二电容阵列142的第一组电容的第一电容c1na的第一电容部分c1na1以将第一电容部分c1na1回切至其重置值(v2)，如表格7所示(步骤s206):
38.表格7
39.电容c1pa1c1pa2c1pb1c1pb2c2pac2pbc3pac3pb下板电压v2v2“v1”v2v2v1v2v1电容c1na1c1na2c1nb1c1nb2c2nac2nbc3nac3nb下板电压“v2”v1v1v1v2v1v2v1
40.在另一些实施例中，在第二转换期间，若第二比较结果显示电压vp小于电压vn，则第一选择电路121将第一参考电压v1输出至第一电容阵列141的第一组电容的第一电容c1pa的第一电容部分c1pa1，第二选择电路122将第二参考电压v2输出至第二电容阵列142的第一组电容的第二电容c1nb的第一电容部分c1nb1，如表格8所示(步骤s206):
41.表格8
42.电容c1pa1c1pa2c1pb1c1pb2c2pac2pbc3pac3pb下板电压“v1”v2v2v2v2v1v2v1电容c1na1c1na2c1nb1c1nb2c2nac2nbc3nac3nb下板电压v1v1“v2”v1v2v1v2v1
43.若第一参考电压v1为接地电压且第二参考电压v2为供电电压，在第一转换期间，若第一比较结果显示电压vp小于电压vn，则第一选择电路121将第二参考电压v2输出至第一电容阵列141的第一组电容的第二电容c1pb的第一电容部分c1pb1及第二电容部分c1pb2，第二选择电路122将第一参考电压v1输出至第二电容阵列142的第一组电容的第一电容c1na的第一电容部分c1na1及第二电容部分c1na2，如表格6所示(步骤s204)。在第二转换期间，若第二比较结果显示电压vp大于电压vn，则第一选择电路121将第一参考电压v1输出至第一电容阵列141的第一组电容的第二电容c1pb的第一电容部分c1pa1，第二选择电路122将第二参考电压v2输出至第二电容阵列142的第一组电容的第一电容c1na的第一电容部分c1na1，如表格7所示(步骤s206)。在另一些实施例中，在第二转换期间，若第二比较结果显示电压vp大于电压vn，则第一选择电路121将第一参考电压v1输出至第一电容阵列141的第一组电容的第一电容c1pa的第一电容部分c1pa1，第二选择电路122将第二参考电压v2输出至第二电容阵列142的第一组电容的第二电容c1nb的第一电容部分c1nb1，如表格8所示(步骤s206)。
44.第一取样期间可属于第一取样阶段，第一转换期间及第二转换期间可属于第一量化阶段，第一取样阶段及第一量化阶段可属于第一操作周期。在第一操作周期后，模拟数字转换器1可依序产生3个比较结果，以及依据3个比较结果输出数字输出数据dout。在接续第一操作周期的第二操作周期，模拟数字转换器1可重复步骤s202至s206以另产生3个比较结果，以及依据另产生的3个比较结果输出后续数字输出数据dout。
45.第二操作周期可包含第二取样阶段及第二量化阶段，第二取样阶段可包含第二取样期间，第二量化阶段可包含第三转换期间及在其后的第四转换期间。第三转换期间可对应第一转换期间，用以产生数字输出数据dout的较高对应位，第四转换期间可对应第二转换期间，用以产生数字输出数据dout的较低对应位。第二转换期间及第四转换期间可不限于直接接续于第一转换期间及第三转换期间。在一些实施例中，当模拟数字转换器1执行第三位转换时，也可用类似的方法来切换第一电容阵列141/第二电容阵列142的第一组电容中的第一电容的第二电容部分或第二电容的第二电容部分，即电容c1pa2,c1pb2,c1na2,
c1nb2。在另一些实施例中，若电容阵列的配置个数较多(例如十位)，可通过将第一电容阵列141/第二电容阵列142的较大一组电容的第一电容及第二电容分别分割为多个电容部分，其分别的容值实质相等于一个或多个较小电容的第一电容的容值大小，可结合方法200在执行除最大位外的其他转换时，若该笔比较结果与最大位结果相异，则即可选择回切较大一组电容的其中一部分电容，来完成该次转换。
46.在一些实施例中，在第二取样期间，第一选择电路121将第一参考电压v1输出至第一电容阵列141中的每组电容的第一电容以及将第二参考电压v2输出至第一电容阵列141中的每组电容的第二电容，第二选择电路122将第一参考电压v1输出至第二电容阵列142中的每组电容的第一电容以及将第二参考电压v2输出至第二电容阵列142中的每组电容的第二电容，如表格1所示。在第三转换期间，比较器16比较第一输入端的电压及第二输入端的电压以产生第三比较结果，第一选择电路121将第二参考电压v2输出至第一电容阵列141的该组较大电容的第一电容c1pa，第二选择电路122将第一参考电压v1输出至第二电容阵列142的该组较大电容的第二电容c1nb，如表格3所示。在第四转换期间，比较器16比较第一输入端的电压及第二输入端的电压以产生第四比较结果，第三比较结果及第四比较结果相异。
47.若第二转换期间及第四转换期间产生的比较结果分别与第一转换期间及第三转换期间产生的比较结果相异，则模拟数字转换器1可在第二转换期间及第四转换期间采用固定切换方式来切换第一电容阵列141及第二电容阵列142，例如固定采用表格4、表格5、表格7及表格8的其中的一个来切换第一电容阵列141及第二电容阵列142。
48.在一些实施例中，模拟数字转换器1也可采用交替切换方式来切换第一电容阵列141及第二电容阵列142，例如交替采用表格4及表格5或交替采用表格7及表格8来切换第一电容阵列141及第二电容阵列142。
49.在另一些实施例中，模拟数字转换器1也可依据均匀随机(uniform random)顺序而随机将表格4及表格5的电压设置输出至第一电容阵列141及第二电容阵列142，或依据均匀随机顺序而随机将表格7及表格8的电压设置输出至第一电容阵列141及第二电容阵列142。均匀随机顺序是一种随机顺序，其中输出表格4及表格5的电压设置的机率实质上相同，或输出表格7及表格8的电压设置的机率实质上相同。
50.在另一些实施例中，模拟数字转换器1也可依据均匀特定顺序而将表格4及表格5的电压设置输出至第一电容阵列141及第二电容阵列142，或依据均匀特定顺序而将表格7及表格8的电压设置输出至第一电容阵列141及第二电容阵列142。均匀特定顺序可为非属纯交替或非属纯随机的顺序，其中输出表格4及表格5的电压设置的机率实质上相同，或输出表格7及表格8的电压设置的机率实质上相同。例如，均匀特定顺序可以是n个量化阶段将表格4的电压设置输出至第一电容阵列141及第二电容阵列142，接续的n个量化阶段将表格5的电压设置输出至第一电容阵列141及第二电容阵列142。在另一个例子中又在另一些例子中，均匀特定顺序可以是由先前量化阶段的对应转换期间是否需要切换来决定本次转换期间要使用表格4或表格5的电压设置输出至第一电容阵列141及第二电容阵列142。
51.在一些实施例中，在第二转换期间第一选择电路121将第一参考电压v1输出至第一电容阵列141的该组较大电容的第一电容c1pa的第一电容部分c1pa1，第二选择电路122将第二参考电压v2输出至第二电容阵列142的该组较大电容的第二电容c1nb的第一电容部
分c1nb1，如表格4所示；在第四转换期间第一选择电路121将第一参考电压v1输出至第一电容阵列141的该组较大电容的第二电容c1pb的第一电容部分c1pb1，第二选择电路122将第二参考电压v2输出至第二电容阵列142的该组较大电容的第一电容c1na的第一电容部分c1na1，如表格5所示。
52.在另一些实施例中，在第二转换期间第一选择电路121将第一参考电压v1输出至第一电容阵列141的该组较大电容的第二电容c1pb的第一电容部分c1pb1，第二选择电路122将第二参考电压v2输出至第二电容阵列142的该组较大电容的第一电容c1na的第一电容部分c1na1，如表格5所示；在第四转换期间第一选择电路121将第一参考电压v1输出至第一电容阵列141的该组较大电容的第一电容c1pa的第一电容部分c1pa1，第二选择电路122将第二参考电压v2输出至第二电容阵列142的该组较大电容的第二电容c1nb的第一电容部分c1nb1，如表格4所示。
53.在另一些实施例中，在第二转换期间第一选择电路121将第一参考电压v1输出至第一电容阵列141的该组较大电容的第二电容c1pb的第一电容部分c1pb1，第二选择电路122将第二参考电压v2输出至第二电容阵列142的该组较大电容的第二电容c1nb的第一电容部分c1nb1，如表格9所示；在第四转换期间第一选择电路121将第一参考电压v1输出至第一电容阵列141的该组较大电容的第一电容c1pa的第一电容部分c1pa1，第二选择电路122将第二参考电压v2输出至第二电容阵列142的该组较大电容的第一电容c1na的第一电容部分c1na1，如表格10所示:
54.表格9
55.电容c1pa1c1pa2c1pb1c1pb2c2pac2pbc3pac3pb下板电压v2v2“v1”v2v1v2v1v2电容c1na1c1na2c1nb1c1nb2c2nac2nbc3nac3nb下板电压v1v1“v2”v1v1v2v1v2
56.表格10
57.电容c1pa1c1pa2c1pb1c1pb2c2pac2pbc3pac3pb下板电压“v1”v2v2v2v1v2v1v2电容c1na1c1na2c1nb1c1nb2c2nac2nbc3nac3nb下板电压“v2”v1v1v1v1v2v1v2
58.在另一些实施例中，在第二转换期间第一选择电路121将第一参考电压v1输出至第一电容阵列141的该组较大电容的第一电容c1pa的第一电容部分c1pa1，第二选择电路122将第二参考电压v2输出至第二电容阵列142的该组较大电容的第一电容c1na的第一电容部分c1na1，如表格10所示；在第四转换期间第一选择电路121将第一参考电压v1输出至第一电容阵列141的该组较大电容的第二电容c1pb的第一电容部分c1pb1，第二选择电路122将第二参考电压v2输出至第二电容阵列142的该组较大电容的第二电容c1nb的第一电容部分c1nb1，如表格9所示。
59.方法200采用回切较大电容的部分电容技巧降低第一电容阵列141及第二电容阵列142中不同组电容之间的电容失配产生的微分非线性误差及积分非线性误差。
60.在一些实施例中，若第一电容阵列141以及第二电容阵列142均为10位二进制权重的电容配置，在每组电容都有以百分之二的电容值为标准差的随机飘移下，当在第二转换
期间以及其后的其他转换期间，可使用方法200操作该组较大电容的电容时，均使用方法200来操作，微分非线性误差会由0.37lsb降低至0.31lsb，积分非线性误差会由0.82lsb降低至0.8lsb。在另一些实施例中，当在第二转换期间以均匀随机顺序或交替顺序切换该组较大电容的第一电容的第一电容部分及该组较大电容的第二电容的第一电容部分时，其微分非线性误差会由0.37lsb降低至0.21lsb，积分非线性误差会由0.82lsb降低至0.48lsb
61.本发明不限于实施例采用的3位sar adc，本领域普通技术人员也可依据本发明的精神将方法200应用于其他大小的sar adc。模拟数字转换器1及操作方法200使用回切技巧切换第一电容阵列141及第二电容阵列142，降低相同组电容或不同组电容之间的电容失配产生的微分非线性误差及积分非线性误差，大幅改善sar adc的线性度。
62.以上所述仅为本发明的较佳实施例，凡依本发明权利要求所做的等同变化与修改，均应属于本发明的保护范围。
63.附图标记说明：
64.1:模拟数字转换器
65.121:第一选择电路
66.122:第二选择电路
67.141:第一电容阵列
68.142:第二电容阵列
69.16:比较器
70.18:控制逻辑电路
71.200:方法
72.s202至s206:步骤
73.c1pa,c1pa1,c1pa2,c1pb,c1pb1,c1pb2,c2pa,c2pb,c3pa,c3pb,c1na,c1na1,c1na2,c1nb,c1nb1,c1nb2,c2na,c2nb,c3na,c3nb:电容
74.dout:数字输出数据
75.sw1,sw2:开关
76.v1:第一参考电压
77.v2:第二参考电压
78.vip,vin:差动输入电压
79.vp,vn:电压