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集成电路版图的自动对齐布线方法与流程

2022-11-14 13:56:01 来源:中国专利 TAG:

技术特征:
1.一种集成电路版图的自动对齐布线方法,其特征在于,包括:创建位图的步骤以建立所述布线起始点和布线终点的走线位图和/或打孔位图;标记位图的步骤以基于标记的所述走线位图和/或所述打孔位图,确定进行所述布线起始点到所述布线终点的布线路径代价;图形对齐的步骤以对所述布线起始点到所述布线终点之间的布线进行图形对齐处理。2.根据权利要求1所述的方法,其特征在于,所述创建位图的步骤,包括:根据所述集成电路版图上每个格点的坐标,创建位图索引。3.根据权利要求1所述的方法,其特征在于,所述创建位图的步骤,包括:根据所述集成电路版图的连接关系描述,确定所述集成电路版图上作为作为布线起始点的第一pin脚,以及作为布线终点的第二pin脚。4.根据权利要求1所述的方法,其特征在于,所述创建位图的步骤,包括;根据第一pin脚图形的长和第二pin脚图形的宽,和/或,根据所述第一pin脚图形的长和所述第二pin脚图形的宽,以及所有格点的位图索引,建立所述布线起始点和布线终点的走线位图和/或打孔位图。5.根据权利要求1所述的方法,其特征在于,所述标记位图的步骤,包括:对所述集成电路版图上的障碍物图形的上下边界和左右边界进行外扩。6.根据权利要求1所述的方法,其特征在于,所述标记位图的步骤,包括:根据障碍物图形的边界的最小间距约束、设定线宽、基于第一pin脚和第二pin脚图形的长或宽定义的线宽,对所述集成电路版图上的障碍物图形的边界进行外扩。7.根据权利要求6所述的方法,其特征在于,若所述走线位图为水平走线位图,则所述根据所述障碍物图形的边界的最小间距约束、设定线宽、基于所述第一pin脚和第二pin脚图形的长或宽定义的线宽,对所述集成电路版图上的障碍物图形的边界进行外扩,包括:根据所述障碍物图形的边界的最小间距约束、基于所述第一pin脚和第二pin脚图形的长或宽定义的线宽,对所述集成电路版图上的障碍物图形的上下边界进行外扩;根据所述障碍物图形的边界的最小间距约束、设定线宽,对所述集成电路版图上的障碍物图形的左右边界进行外扩。8.根据权利要求6所述的方法,其特征在于,若所述走线位图为水平走线位图,则所述根据所述障碍物图形的边界的最小间距约束、设定线宽、基于所述第一pin脚和第二pin脚图形的长或宽定义的线宽,对所述集成电路版图上的障碍物图形的边界进行外扩,包括:根据所述障碍物图形的边界的最小间距约束、基于所述第一pin脚和第二pin脚图形的长或宽定义的线宽,对所述集成电路版图上的障碍物图形的左右边界进行外扩;根据所述障碍物图形的边界的最小间距约束、设定线宽,对所述集成电路版图上的障碍物图形的上下边界进行外扩。9.根据权利要求6所述的方法,其特征在于,针对所述打孔位图,所述标记位图的步骤,包括:根据通孔的间距、通孔的宽、通孔的高,对所述集成电路版图上的障碍物图形的边界进行外扩。10.根据权利要求9所述的方法,其特征在于,所述根据通孔的间距以及孔高,对所述集成电路版图上的障碍物图形的边界进行外扩,包括:根据通孔的间距、通孔的高,对所述集成电路版图上的障碍物图形的上下边界进行外扩;根据通孔的间距、通孔的宽,对所述集成
电路版图上的障碍物图形的左右边界进行外扩。

技术总结
本申请实施提供一种集成电路版图的自动对齐布线方法,其包括:创建位图的步骤以建立所述布线起始点和布线终点的走线位图和/或打孔位图;标记位图的步骤以基于标记的所述走线位图和/或所述打孔位图,确定进行所述布线起始点到所述布线终点的布线路径代价;图形对齐的步骤以对所述布线起始点到所述布线终点之间的布线进行图形对齐处理,从而提高布线效率,增加设计的可行性。增加设计的可行性。


技术研发人员:孙若涵 张亚东 李起宏 陆涛涛 刘晓明
受保护的技术使用者:北京华大九天科技股份有限公司
技术研发日:2022.08.19
技术公布日:2022/11/11
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