针对使用电路模板的电路设计的提取的布局依赖效应的重用的制作方法

针对使用电路模板的电路设计的提取的布局依赖效应的重用
1.本技术是申请日为2017年02月24日、申请号为201780001284.8、发明名称为“针对使用电路模板的电路设计的提取的布局依赖效应的重用”的中国发明专利申请的分案申请。


背景技术：

2.本公开总体上涉及集成电路的设计，并且具体地涉及针对使用电路模板的电路设计的提取的布局依赖效应(lde)的重用。
3.相关技术的描述
4.集成电路的设计流程通常包括晶体管级设计和仿真以产生干净原理图设计的步骤。设计流程还包括为仿真原理图创建布局并且在该布局上运行布局对原理图(lvs)检查和设计规则检查(drc)。lvs 是指确定特定集成电路布局是否对应于原始原理图设计，而drc是指确定特定芯片的物理布局是否满足一系列称为设计规则的推荐参数。一旦布局确定为lvs和drc干净，就可以从布局中提取诸如电路寄生效应(例如电线的电容)的布局依赖效应(lde)信息。lde 信息可以反向注释到布局前原理图，并执行重新仿真以确定lde对设计性能的影响。lde信息提取、反向注释和重新仿真通常导致设计更改，从而导致额外的布局变化，从而导致更多的设计迭代。在较小的几何工艺中，lde对集成电路设计的影响较大，这种现象变得更加严重。


技术实现要素：

5.实施例涉及针对使用电路模板的电路设计的提取的lde信息的重用。从布局中提取电路段的lde信息以生成电路模板。电路模板在集成电路的原理图中实例化。使用电路段的lde信息在原理图上进行仿真，而不产生集成电路的布局。
6.在一个实施例中，接收包括电路段的第一集成电路的原理图。在第二集成电路的原理图中实例化对应于电路段的电路模板。电路模板包括从第一集成电路的布局提取的电路段的布局依赖效应信息。使用电路段的布局依赖效应信息对第二集成电路的原理图执行仿真。响应于执行仿真而产生对应于电路段的第二集成电路的至少一部分的布局。
7.在一个实施例中，接收包括电路段的第一集成电路的原理图。通过至少参考对应于电路段的电路模板中的电路段的lde信息，对包含电路段的第二集成电路的原理图执行仿真。从第一集成电路的布局中提取用于电路段的lde信息。响应于执行仿真而产生对应于电路段的第二集成电路的至少一部分的布局。
8.在一个实施例中，lde包括以下中的一个或多个：电路段的部件和节点的寄生信息；电路段的部件的多晶硅间隔和多晶硅长度效应；电路段的部件的浅沟槽隔离效应；以及电路段的部件的阱邻近效应。
9.在一个实施例中，提取用于电路段的lde信息包括从第一集成电路的布局提取用于第一集成电路的lde信息。对提取的第一集成电路的lde信息进行过滤，以识别与电路段中的部件和节点相对应的lde信息。
10.在一个实施例中，提取的lde信息的过滤包括解析用于第一集成电路的提取的lde信息，以构建解析树。遍历解析树，并去除不对应于电路段中的部件和节点的lde信息。剩余的lde信息被写入电路模板。
11.在一个实施例中，第一集成电路的原理图中的电路段的部件和节点的名称被标准化以包括在电路模板中。
12.在一个实施例中，从第一集成电路的布局中提取层映射信息，并且层映射信息被写入电路模版。
13.在一个实施例中，实例化电路模板包括生成用于第二集成电路的原理图的映射。该映射将第二集成电路原理图中的部件和节点的实际名称与电路模板中的经标准化的名称相关联。
14.在一个实施例中，实例化电路模板包括使用电路模板中的层映射信息和包括用于第二集成电路的层特定因子的制造信息来重新调整电路模板中的电路段的lde信息。
15.在一个实施例中，电路段对应于一个或多个电路模板。每个电路模板均对应于电路段的不同物理实现。
16.在一个实施例中，对于与电路段对应的每个电路模板，使用电路模板中的lde信息对第二集成电路的原理图执行仿真。基于用于实例化第二集成电路的原理图中的所选择的电路模板的仿真来选择一个或多个电路模板中的一个。
17.在一个实施例中，在不产生第二集成电路的布局的情况下对第二集成电路的原理图执行仿真。
18.在一个实施例中，生成第一集成电路的布局。从第一集成电路的布局中提取电路段的lde信息。
附图说明
19.通过结合附图考虑以下详细描述，可以容易地理解本发明实施例的教导。
20.图1是示出根据实施例的用于设计和制造集成电路的各种操作的示例流程。
21.图2是示出根据实施例的用于执行电路的定制设计的示例性计算设备的高级框图。
22.图3是示出根据一个实施例的使用电路模板的提取的布局依赖效应(lde)的重用的示例系统的框图。
23.图4是根据实施例的包括电路段的示例集成电路的电路图。
24.图5是示出根据实施例的从图4的电路模板实例化到示例集成电路的电路图。
25.图6是示出根据实施例的使用电路模板的提取的布局依赖效应的重用的过程的流程图。
26.附图仅仅为了说明的目的描绘了本发明的各种实施例。本领域技术人员将从下面的讨论中容易地认识到，在不脱离本文描述的原理的情况下，可以采用本文所示的结构和方法的替代实施例。
具体实施方式
27.在以下对实施例的描述中，阐述了许多具体细节以便提供更彻底的理解。然而，注
意，可以在没有这些具体细节中的一个或多个的情况下实践本发明。在其他情况下，还没有详细描述众所周知的特征，以避免不必要地使描述复杂化。
28.这里参考附图描述实施例，其中相同的附图标记表示相同或功能相似的元件。同样在图中，每个附图标记的最左边的数字对应于首先使用参考号的图形。
29.实施例涉及使用电路模板的提取的lde的重用。从布局中提取电路段的lde信息，并将其包括在电路模板中。使用电路模板，相应的电路段可以在集成电路的原理图中实例化。可以使用lde信息来执行原理图上的更准确的仿真，这导致对集成电路的设计更改的迭代次数更少。
30.本文描述的电路模板是指包含用于电路段的降低的连接性信息的表示的电路段的设计抽象，以及用于与电路段相关联的部件和节点的lde信息。电路模板还可以包含电路段的部件和节点的设计约束或标准化名称。
31.eda设计流程概述
32.图1是示出根据实施例的用于设计和制造集成电路的各种操作的示例流程100。设计过程100从产生产品创意110开始，该产品创意是在使用电子设计自动化(eda)软件112的设计过程中实现的。当设计完成时，可以使其下线(tape-out)134。在下线134之后，制造 136半导体管芯以形成集成电路设计中的各种物体(例如栅极、金属层、通孔)。执行封装和组装过程138，从而生产出成品芯片140。
33.eda软件112可以在一个或多个计算设备中实现，例如下文参照图2示出和描述的计算设备200。例如，eda软件112作为指令存储在计算机可读介质中，该指令由处理器执行，用于执行下文描述的设计流程的操作114-132。此设计流程描述仅供说明之用。具体地，该描述并不意味着限制本公开。例如，实际的集成电路设计可能需要设计人员以与本文所描述的顺序不同的顺序执行设计操作。
34.在系统设计114期间，设计人员描述要实现的功能。他们还可以执行假设计划(what-if planning)来优化功能并检查成本。应注意，硬件-软件架构分区可能在此阶段发生。可在此阶段使用的加州山景城synopsys公司的eda软件产品示例包括：生。可在此阶段使用的加州山景城synopsys公司的eda软件产品示例包括：和产品。
35.在原理图捕获和验证116期间，写入电路中的模块的vhdl或 verilog代码，并检查设计的功能准确性。更具体地，检查设计以确保其产生正确的输出。可在此阶段使用的加州山景城synopsys公司的eda软件产品包括：山景城synopsys公司的eda软件产品包括：和产品。
36.在测试的合成和设计118期间，将vhdl/verilog转换为网表。该网表可针对目标技术进行优化。此外，可以设计和实施测试以检查成品芯片。可在此阶段使用的加州山景城synopsys公司的eda软件产品包括：synopsys公司的eda软件产品包括：和产品。
37.在网表验证120期间，检查网表以符合时序约束并且符合 vhdl/verilog源代码。可在此阶段使用的加州山景城synopsys公司的eda软件产品示例包括：
和产品。
38.在设计计划122期间，构建并分析芯片的总平面图，用于定时和顶层布线。可在此阶段使用的加州山景城synopsys公司的eda软件产品示例包括：和产品。
39.在物理实现124期间，发生放置(电路元件的定位)和布线(对其进行连接)。可在此阶段使用的加州山景城synopsys公司的eda 软件产品示例包括：custom compiler、和产品。本文描述的实施例主要涉及物理实现124。
40.在电路分析126期间，在晶体管级验证电路功能，这允许精细化。可在此阶段使用的加州山景城synopsys公司的eda软件产品示例包括：和star产品。在物理验证128期间，检查设计以确保：制造、电气问题、光刻问题和电路系统的正确性。
41.在分辨率增强130期间，执行布局的几何操作以提高设计的可制造性。可在此阶段使用的加州山景城synopsys公司的eda软件产品示例包括：af和产品。
42.在掩模数据准备132期间，提供用于产生用于生产成品芯片的掩模的“下线”数据。可在此阶段使用的加州山景城synopsys公司的 eda软件产品示例包括系列产品。
43.可以在逻辑设计和功能验证116阶段执行正式验证116。低功率设计规范通常在用于测试118或网表验证120的合成和设计阶段期间被处理。
44.示例计算设备
45.图2是示出根据实施例的用于设计集成电路的示例性计算设备 200的高级框图。计算设备200包括耦合到芯片组204的至少一个处理器202。芯片组204包括存储器控制器集线器220和输入/输出(i/o) 控制器集线器222。存储器206和图形适配器212耦合到存储器控制器集线器220，以及显示器218耦合到图形适配器212。存储设备208、键盘210、指向设备214和网络适配器216耦合到i/o控制器集线器 222。计算设备200的其他实施例具有不同的架构。
46.存储设备208是诸如硬盘驱动器、光盘只读存储器(cd-rom)、 dvd或固态存储器设备之类的非暂时性计算机可读存储介质。存储器206保持由处理器202使用的指令和数据。指向设备214是鼠标、轨迹球或其他类型的指向设备，并且与键盘210组合使用以将数据输
47.计算设备200适于执行用于提供本文所描述的功能的计算机程序模块。如本文所使用的，术语“模块”是指用于提供指定功能的计算机程序逻辑。因此，可以在硬件、固件和/或软件中实现模块。在一个实施例中，程序模块存储在存储设备208上，被加载到存储器206中并由处理器202执行。所使用的计算设备200的类型可以根据实施例和要求而变化。例如，计算设备可能缺少图2所示的显示器、键盘和/或其他设备。
48.以下参考下文的图3详细描述的交互式电路设计系统300可以由计算设备200实现。
49.重用布局依赖效应的示例系统
50.图3是示出根据一个实施例的用于基于电路模板重用提取的lde 信息的示例系统的框图。交互式电路设计系统300通过在设计人员输入被接收时显示、建立和修改部件和连接来交互地进行实例化和路由部件和连接的操作(而不是在接收到一系列设计人员输入之后批处理部件和连接，而不中间显示部件和连接)。
51.为此，交互式电路设计系统300与电路设计数据库350进行通信，并通过输入设备(例如，键盘210、鼠标214)和输出设备(例如，显示设备218)与设计人员进行交互。由设计人员经由输入设备210、 214提供的设计人员输入可以指示交互式电路设计系统300在集成电路的原理图中实例化电路模板，建立或修改去往或来自电路段的、在电路段的节点和部件之间的连接，并且在显示器218上显示这样的连接。
52.电路设计数据库350是与交互式电路设计系统300交互以存储原理图和布局数据352以及修改的原理图和布局数据354的数据库。如本文所使用的物理布局数据352包括物理几何布局的图案、原理图布局映射信息(以下称为“映射信息”)、金属层数量以及与制造电路相关的物理工艺。映射信息可以指示一个或多个电路元件中的节点到一个或多个节点子集的分组，以及一个或多个电路元件中的节点或部件与一个或多个电路元件中的其他节点或部件的对应关系。
53.经修改的原理图和物理布局数据354是通过交互式电路设计系统 300相对于原始原理图和物理布局数据352进行修改的电路数据的版本。图案的物理几何布局是电路的数字表示，例如，gdsii格式。经修改的原理图和物理布局数据354包括在物理布局数据352中不存在于图案的物理几何布局中的路由连接的模式的修改的布置、修改的原理图或物理几何布局。表示新生成的电路连接的附加信息被包括在经修改的物理布局数据354中。
54.电路设计数据库350可以例如被实现为openaccess数据库。尽管电路设计数据库350被描述为与交互式电路设计系统300分离的组件，但是电路设计数据库350可以是交互式电路设计系统300的一部分。例如，电路设计数据库350可以是存储器206中的模块。
55.交互式电路设计系统300可以包括i/o控制器集线器222、存储器206和图形适配器212等。i/o控制器集线器222从输入设备210 和214接收设计人员输入以及来自交互式电路设计系统300外部的电路设计数据库350的原理图和物理布局数据，处理接收到的设计人员输入以及接收的原理图和物理布局数据，并将处理的信息提供给存储器206。
56.除了其他模块之外，存储器206可以包括示意性设计模块304、电路仿真器308、物理实现模块312、模板生成模块316、设计规则检查(drc)模块320和布局对原理图(lvs)模块324。存储器206 可以包括图3中未示出的其他软件组件(例如，操作系统)。存储器 206还可以仅包括这些模块的子集。
57.示意图设计模块304是使用抽象的图形符号创建集成电路的部件、节点和其他元件的表示(例如，下面参照图4所示的集成电路400) 以及文字表示的软件模块。原理图设计模块304创建使用符号来表示部件并强调它们的互连路径的集成电路的原理图。原理图设计模块304可以包括原理图捕获工具和原理图输入工具。原理图设计模块304 可以集成到整个电路设计流程中并且链接到其他eda工具以用于电路的验证和仿真。原理图设计模块304在原理图设计期间在集成电路的原理图中实例化电路模板，如下面参考图5所示和所描述的。
58.电路仿真器308是使用数学模型来复制集成电路的行为的软件模块。电路仿真器
308可以是严格的模拟电子电路仿真器，或者可以包括模拟和事件驱动的数字仿真能力(例如，混合模式仿真器)。整个混合信号分析可以从一个集成原理图驱动。电路仿真器308中的数字模型提供集成电路中部件和节点的传播时间和上升/下降时间延迟的规范。原理图设计模块304通过电路模板的实例将集成电路中的电路段的lde信息相关联。例如，电路段的详细寄生效应(基于实际设计布局)可以经由用于电路段的电路模板并入到电路原理图中。电路模拟器308允许在其中放置电路模板的一个或多个实例的目标设计 (例如放大器或比较器)的预布局仿真中重用这样的lde信息。
59.物理实现模块312是根据平面几何形状创建集成电路的部分的表示的软件模块，其对应于组成集成电路的部件的金属、氧化物或半导体层的图案。物理实现模块312基于原理图生成集成电路的布局，并从布局提取用于电路段的lde信息，如下面参照图4所述。物理实现模块312响应于利用用于电路段的lde信息执行仿真而生成集成电路的至少一部分的布局，其中该部分对应于该电路段。
60.模板生成模块316是接收用于电路段的原理图信息和用于包括电路段的集成电路的布局的lde信息的软件模块。模板生成模块316 生成电路段的设计抽象，包括用于电路段的降低的连接性信息的表示。模板生成模块316从包括电路段的集成电路的布局的lde信息中提取用于电路段的lde信息，以生成电路模板，如下面参照图4 所示和描述的。电路模板存储在电路模板数据库360中。模板生成模块316将电路模板中的lde信息364和连接信息发送到电路模板数据库360。原理图设计模块304从电路模板数据库360接收电路模板 362。
61.drc模块320是确定特定芯片的物理布局是否满足一系列设计规则的软件模块。本领域众所周知的设计规则是指半导体制造商推荐的一般参数，以确保半导体制造商可以制造合适的集成电路。当违反设计规则时，drc模块320提示违反设计人员的纠正措施或自动修改物理布局以符合设计规则。
62.lvs模块324是确定由物理实现模块312创建的特定集成电路布局是否对应于由原理图设计模块304创建的设计的原理图的软件模块。lvs模块324检查绘制到在布局期间使用基于区域的逻辑运算来表示电路，以通过它们的结构层来确定图中所示的半导体部件。lvs 模块324将所提取的组件组合成串联和并行组合，并生成布局数据库的网表表示。lvs模块324在原理图上执行类似的减少。lvs模块 324将提取的布局网表与电路原理图进行比较。
63.示例电路段
64.图4是根据实施例的包括电路段404的示例集成电路400的电路图。集成电路400表示电流镜像负载差分放大器示例。标记为“vdd”的节点424和428向集成电路400提供电压。集成电路400包括由加载差分对电路段404的晶体管416和420制成的电流镜。集成电路400 中的电流镜通过控制另一个有源器件中的电流、保持输出电流恒定 (不管负载如何)来复制一个电流通过一个有源器件。差分对电路段 404由电流镜加载，并且对两个输入信号436和440之间的差施加增益。差分对404由晶体管408和412构成。节点436和440是到电流镜像负载差分放大器400以及到差分对电路段404的两个输入。集成电路400的输出节点444产生在输入节点436和440处接收的差分信号的放大版本。
65.随着工艺几何形状的减小，纳米尺度器件的接近使它们相互作用并产生称为lde的新型变异性。例如，接近效应可以将晶体管电流降低10％或更多，或者将阈值电压(vt)改
变几十mv。在部件布局和电路所需的布线互连之后，从集成电路中提取lde信息。lvs和布局寄生提取(lpe)工具可以提取和测量lde，将这些值作为实例参数放置在文件中，例如，作为详细的标准寄生格式(dspf)文件。
66.该效应被认为是实例参数，例如，出现在dspf文件实例部分的线上的新参数。lde信息提取的目的是创建集成电路的精确模拟模型，以便对原理图和详细仿真的lde信息进行背面注释可以模拟实际的数字和模拟电路响应。
67.在典型的电路设计流程中，在提取寄生效应和其他lde信息之前，电路设计从原理图设计进行到完成的lvs和drc清洁布局。然后将lde信息反向注释到预布局原理图，并执行重新仿真以确定lde 对设计性能的影响。这里，在实施例中，通过重用将lde(基于实际设计布局)与电路段(例如差分对404或电流镜)相关联的电路模板来改善电路设计效率，之后允许在其中放置电路模板的一个或多个实例的电路设计的预布局仿真(例如下面参考图5或比较器示出的放大器500)中重用lde信息。
68.lde可以包括例如(i)电路寄生效应，(ii)多晶硅间隔效应(pse) 和多晶硅长度效应，(iii)浅沟槽隔离(sti)效应和(iv)阱邻近效应(wpe)。首先，电路寄生效应包括互连电阻、互连电容和互连电感。图4中的示例性电阻448表示已经从集成电路400的布局提取并反向注释到图4所示的原理图上的输入节点436上的寄生电阻。图4 中的示例性电容452表示已经从集成电路400的布局提取并反向注释到图4所示的原理图上的晶体管412的寄生漏-源电容。图4中的示例电容456表示已经从集成电路400的布局提取并反向注释到图4所示的原理图上的晶体管420的寄生栅-漏电容。
69.pse和ple是指多晶硅“虚拟”栅极对电路中的器件的均匀性(例如，图4的实施例中的器件408和412)的长度和间隔效应。pse和 ple可能影响晶体管中的漏极电流并影响集成电路400的性能。
70.sti(也称为盒隔离技术)是集成电路设计特征，其防止相邻半导体器件组件之间的电流泄漏。sti效应是由沟槽隔离的硅应力引起的。sti设计过程留下了处于双轴压应力非均匀状态的硅岛。sti可以增加电子迁移率，从而增加负沟道金属氧化物半导体(nmos)电流。sti可以增加空穴迁移率，从而增加正沟道金属氧化物半导体 (pmos)电流。sti也可能影响设备的vt。
71.wpe是指器件(晶体管)与阱的边缘的接近度。该距离对设备的 vt有影响。原因是植入离子从用于限定阱的抗蚀剂侧壁散射，从而将 vt增加若干甚至几十毫伏。可以从集成电路400的布局提取的其他 lde信息包括扩散效应的长度、近似扩散效应(nde)(影响器件均匀性和引起器件参数变化)、光刻舍入效应(litho rounding effect)(产生对poly和扩散角的舍入效应)等的信息
72.模板生成模块316从来自集成电路400的布局的集成电路400的提取的lde信息(例如，在dspf文件中)提取电路段404的lde 信息。例如，模板生成模块316可以搜索到包含与集成电路400相关联的lde的dspf文件的路径。在备选实施例中，还可以搜索用于更高级别设计块(即其中集成电路400本身被实例化，例如实例化图 4的放大器的压控振荡器电路)的dspf文件的路径。
73.模板生成模块316对集成电路400的提取的布局依赖效应信息进行过滤，以识别对应于电路段404中的部件(例如，晶体管412)和节点的布局依赖效应信息(例如，电容452)。
模板生成模块316通过解析用于集成电路400的提取的布局依赖效应信息来构建解析树，来对集成电路400提取的布局依赖效应信息进行过滤。解析树表示 dspf文件数据的基础结构，存储在数据结构中。模板生成模块316 遍历解析树并去除不对应于电路段404中的部件和节点的lde信息 (例如，电容456)。生成电路模板包括标准化电路段的部件和节点的名称以包括在电路模板中，如下所述。
74.模板生成模块316可以读取用于集成电路400的dspf文件，并将其过滤到仅与电路段404的部件和节点相关联的信息。原始dspf 文件可以包含用于所有集成电路400的网络的lde信息。在一个实施例中，也可以过滤用于电力网络的lde信息。模板生成模块316 识别并去除未电连接到所选择的电路段节点的节点(直接或间接经由寄生电阻网络)。剩余的子节点和元件(例如，电阻448和电容452) 通过下面描述的名称标准化方法将它们的名称标准化并适当地“唯一化”。
75.模板生成模块316在解析树遍历过程中初始化两个列表，一个用于节点信息，一个用于部件信息。然后解析dspf文件的每一行，如果该行是节点行(也匹配任何可选的指定部件规范)，则新的节点数据结构将被初始化并添加到节点列表中。这个新结构也被标记为当前节点结构。如果该行不是节点行，而是在dspf文件的部件部分内，则将其解析为部件行，并解析附加到部件的列表中的信息(当提供可选指定的部件规范时，仅附加符合本规范的部件)。如果它不是部件行，则将其解析为节点元件项，例如子节点、部件引脚或寄生r或c 元件，并将其解析树附加到当前标记的节点结构(再次，可选指定的部件规范首先用作过滤器)。每个节点的节点元件细节(子节点、实例引脚和寄生效应)都与数据结构中的节点本身相关联，并且已经应用任何可选的组件规范过滤。
76.模板生成模块316遍历在上述解析过程期间创建的节点结构。当遇到每个节点时，将检查它是否感兴趣。如果节点与模板的任何组件的直接互连相关联，则该节点是“感兴趣的”。如果节点不与这样的直接互连(例如，下面的图4中的节点424或428)相关联，则不感兴趣。如果节点感兴趣，节点将被归一化(将其名称替换为节点映射中的对应值)并写入模板，并且该过程继续到与该节点相关联的节点元素。检查每个节点元素以查看其字段是否感兴趣，如果是，则在写入模板之前再次将这些“模板(stencilization)”应用于这些节点字段。此外，在写入模板之前，电阻和电容元件通过将字符串附加到其实例名称而被唯一化。当所有节点耗尽时，遍历这些部件。考虑每个感兴趣的部件，并且其实例名称在写入模板之前用来自实例名称映射的相应值进行标准化。此外，其节点字段也与网络名称映射进行比较，并模板化为其他任何节点项。
77.模板生成模块316可以从集成电路400的布局提取层映射信息，并将层映射信息写入电路模板。半导体层映射信息是指用于制造特定工艺(例如22nm或12nm工艺)的材料层的参数。这些层可以包括体材料，例如si、ge、gaas、用于产生p型和n型区的掺杂剂、以及用于形成接触的金属化物。层映射信息提供物理信息，例如在用于实现集成电路400设计的过程中的层片电阻率与在用于实现稍后的目标设计的过程中的相应层片电阻率的映射。这允许lde模板从一个过程“移植”到另一个过程。
78.电路模板实例化为集成电路
79.图5是根据一个实施例的电路图，其示出了用于上述图4的电路段404的电路模板到示例集成电路500中的实例。图5示出了示例性多级运算放大器的一部分。集成电路500使
用vdd电源504、508和 512。集成电路500中的节点528、572和556接地。由晶体管516和 520形成的电流镜向集成电路500提供偏置电流。集成电路500实例化由晶体管560和564形成的电流镜，其主动地加载电路段404。去往集成电路500的输入是节点436和440。集成电路500的第二级由晶体管552组成，其是主动加载有电流源晶体管524的公共源极放大器。电容器568包括在第二级的负反馈路径中。集成电路500的输出是节点548。
80.电路段404在集成电路500的原理图中通过对图4中所示的电路段404的模板进行实例化来创建。电路段404包括晶体管408和412。如图5所示，在集成电路500的原理图中，参照图4的电路段404的模板中的lde信息(电阻448和电容452)。
81.将来自图4的电路段404的模板实例化为图5中的集成电路500 的原理图包括为图5中的集成电路500的原理图生成映射。映射将图 5中的集成电路500的原理图中的节点和部件的实际名称与如下电路模板中的标准化名称进行关联。由于电路段404的模板在集成电路 500的原理图中被实例化，所以为其生成部件和节点映射，并且在图示数据库350中注释为属性354，如上参考图3所示。映射是从集成电路500的原理图中的实际放置的名称到作为电路模板数据库360中的模板定义的一部分存储的标准化名称(例如，408和412)，如上参考图3所示。对于便利性，反向部件和节点名称映射也可以被生成并注释到数据库360中放置的模版容器对象上。
82.在备选实施例中，代替将上述图4的电路段404的模板实例化为集成电路500的原理图，通过至少参考对应于电路段404的电路模板中的电路段404的led信息而对集成电路500的原理图执行仿真。
83.原理图设计模块304使用电路段404的电路模板中的原始lde 信息来产生一个或多个实际有效的dspf文件，其中集成电路500设计节点和部件名称被替换为标准化名称，从而正确地建立每个单独放置的模板实例的寄生连接。对于寄生元件r和c)项(例如，电阻 448和电容452)，也可以替换唯一值，当确定存在多个渲染模板时，确保独特的寄生效应。模板实例化过程的主要输入包括电路模板和节点以及部件名称映射。输入节点名称映射包括从标准化模板名称到实际目标网络名称的映射。类似地，输入组件名称映射包括从标准化部件名称到实际目标部件名称的映射。也可以为每个模版实例生成一个唯一的标识符，以便“唯一化”寄生部件名称。所得到的dspf文件也可以以标准dspf文件头为前缀，以便将其内容标识给电路仿真器 308。
84.在一个实施例中，为集成电路500的原理图中的电路段404实例化电路模板包括使用电路模版中的层映射信息对电路模板中的电路段404的布局依赖效应信息以及包括用于第二集成电路的层特定因子的制造信息进行重新调整。制造信息可以包括用于金属层、场氧化物、 n-阱、栅极氧化物、多晶硅、氮化物等的参数。例如，寄生电阻值(例如，电阻448)可以通过计算来自层映射信息的片电阻比率、并且将原始电阻值乘以适当的层特定比率因子来进行调整。原理图设计模块 304产生完全呈现的dspf文件作为包括模板的原理图设计过程的输出。
85.在一个实施例中，为每个放置的模板实例生成单个dspf文件。在备选实施例中，为包含所有模版实例的单元生成单个dspf文件。在这种情况下，所有渲染的dspf内容可以一起连接成一个容器。在另一个实施例中，dspf文件是在每个模板的基础上产生的，其中表示该特定模板的所有实例。例如，生成一个dspf文件，其包含所有差分对模板实例的lde信息，
还包含对于所有当前的镜像实例的另一lde信息，还包含对于所有级联阶段实例的第三个lde信息。也可以生成其他分区/组合(例如，在一个dspf文件中具有nmos部件的所有模板，在另一dspf文件中具有pmos组件的所有模板等)，而不脱离本领域的精神。
86.最后，渲染的dspf文件使得可用于原理图设计模块304，允许设计者选择哪些背面注释(或不背面注释)到预布局原理图上。
87.在一个实施例中，电路段404可以对应于一个或多个电路模板。每个这样的电路模板对应于电路段404的不同的物理实现。例如，不同的物理实现可以对应于不同的平面几何形状，其对应于构成电路段 404的组件的金属、氧化物或半导体层的不同图案。最终集成电路的行为取决于几何形状的位置和互连。不同的物理实现可以被设计为在性能、大小、密度和可制造性方面满足不同的标准。电路仿真器308 可以使用对应于电路段404的每个电路模板的不同电路模板中的 lde信息来对集成电路500的不同原理图执行仿真。原理图设计模块 304可以基于仿真来选择电路模板之一，用于更新集成电路500的原理图。
88.在备选实施例中，电路段404的布局可以使用原理图驱动布局 (sdl)流来编写。模板生成模块316接收电路段404的布局。在这种情况下，原理图设计模块304中的示意性电路段404形状的选择还虑及在物理实现模块312中相关的布局源设计形状的对应选择，这是由于在sdl期间由物理实现模块312维护的对应映射。生成这些布局形状被分别放置的新布局模板视图。由于从电路段404原理图和布局视图可以获得完整的sdl对应关系，因此从原理图到新创建的布局模板视图快速构建相应的完整对应关系。新布局可以通过现有的 lvs、drc和lde提取流程进行定稿并通过，如上面参考图1所示。然后，所得到的提取的dspf文件可以作为输入传递到模板生成过程。
89.在一个实施例中，可以在对集成电路500的原理图进行仿真之后修改集成电路500的原理图。例如，当重用电路模板时，可以修改集成电路500的原理图，段404揭示了仿真期间集成电路500中的设计缺陷。
90.所要求保护的实施例的优点和优点包括通过使用电路模板提供“辅助”自动化、层级和分级设计的优点而不会施加处理分级接口的用户负担，从而提高电路设计流程的效率，并减少设计迭代和周转时间。
91.重复使用布局依赖效应的示例过程
92.图6是示出根据实施例的使用电路模板的提取的布局依赖效应的重用的过程的流程图。在一些示例性实施例中，该过程可以具有与结合图6所描述的不同的和/或附加的步骤。该过程的步骤也可以以与结合图6描述的顺序不同的顺序执行。可以并行执行一些步骤。备选地，可以并行执行一些步骤，并且顺次地执行一些步骤。或者，一些步骤可以以流水线方式执行，使得在执行前一步骤之前开始步骤的执行。
93.原理图设计模块304接收包括来自电路设计数据库350的电路段 (例如，电路段404)的集成电路(例如，集成电路500)的原理图。原理图设计模块304接收604对应于来自电路模板数据库360的电路段404的电路模板。电路模板包括从集成电路(例如，集成电路400) 的布局提取的用于电路段404的lde信息。
94.原理图设计模块304通过在原理图中实例化电路模板来更新608 集成电路500的原理图。电路模拟器308使用用于电路段404的lde 信息对更新的原理图执行仿真，而不产生集成电路500的更新的布局。响应于执行仿真，物理实现模块312使用更新的原理图生成
集成电路 500的至少一部分的布局。该部分对应于电路段404。
95.为了说明的目的已经呈现了对实施例的前述描述；它不是穷举的或将本发明限制于所公开的精确形式。本领域的技术人员可以理解，鉴于上述公开内容，许多修改和变化是可能的。
96.最后，本说明书中使用的语言主要是为了可读性和教导目的而选择的，并且它可能没有被选择来描绘或限定本发明的主题。因此，意图的范围不受该详细描述的限制，而是由在此之上的申请发布的任何权利要求。因此，实施例的公开内容旨在说明但不限于所附权利要求中阐述的范围。